Questão de Arquitetura de Computadores — Arquitetura de processadores: RISC, CISC, WISC e Microprocessadores. — FCC 2017
Arquitetura de Computadores›Arquitetura de processadores: RISC, CISC, WISC e Microprocessadores.
Código
fc037964
Banca
FCC
Órgão
TRE-PR
Ano
2017
Nível
Médio
Cargo
Técnico Judiciário - Operação de Computadores
One difference between CISC and RISC is that CISC processors
Ahave complex instructions that take up multiple clock cycles for execution. RISC processors have simple instructions taking about one clock cycle.
Bare highly pipelined. RISC processors are normally not pipelined or less pipelined.
Ctransfer complexity to the compiler that executes the program. The complexity of RISC lies in the micro program.
Dhave a fixed instruction format. RISC processors have variable instruction format.
Ehave multiple register sets. RISC processors only have a single register set.
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GabaritoA — have complex instructions that take up multiple clock cycles for execution. RISC processors have simple instructions taking about one clock cycle.
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Diferenças entre CISC e RISC
Gabarito: letra A. A principal diferença entre as arquiteturas CISC e RISC está na complexidade das instruções: enquanto o CISC possui instruções complexas que exigem múltiplos ciclos de clock para execução, o RISC adota instruções simples que executam em aproximadamente um ciclo. Esse conceito é amplamente aceito na arquitetura de computadores.
A banca testa o conhecimento das características fundamentais de cada arquitetura. Vamos analisar cada alternativa:
Alternativa A — ✅ Correta ⟵ GABARITO
A alternativa afirma que processadores CISC têm instruções complexas que consomem múltiplos ciclos de clock, enquanto RISC tem instruções simples executadas em cerca de um ciclo. Isso é consistente com a definição clássica: CISC (Complex Instruction Set Computer) possui um conjunto amplo e complexo de instruções, muitas delas microprogramadas, demandando mais ciclos. RISC (Reduced Instruction Set Computer) foca em instruções simples e de execução rápida, tipicamente um ciclo por instrução.
Alternativa B — ❌ Incorreta
Afirma que CISC é altamente pipelineado e RISC não ou menos. Na verdade, o pipeline é uma técnica comum em ambos, mas historicamente RISC foi projetado para facilitar o pipeline com instruções de tamanho fixo e formato regular. CISC, com instruções de tamanho variável e maior complexidade, enfrenta mais desafios para pipeline. A afirmativa inverte a realidade.
Alternativa C — ❌ Incorreta
Diz que CISC transfere complexidade para o compilador e que a complexidade do RISC está no microprograma. É o oposto: em RISC, a complexidade é deslocada para o compilador (que deve combinar instruções simples para tarefas complexas); em CISC, a complexidade reside no hardware (microprograma) que implementa instruções complexas diretamente.
Alternativa D — ❌ Incorreta
Afirma que CISC tem formato de instrução fixo e RISC variável. Na verdade, RISC geralmente adota formato fixo (mesmo número de bits para todas as instruções), facilitando o decodificação. CISC tradicionalmente possui formato variável, com instruções de diferentes comprimentos.
Alternativa E — ❌ Incorreta
Diz que CISC possui múltiplos conjuntos de registradores e RISC apenas um. RISC costuma ter um número maior de registradores de propósito geral (vários conjuntos) para otimizar acesso a dados. CISC tem menos registradores e depende mais da memória. A afirmativa é contrária à prática.
PEGA ESSA DICA!
Para questões de arquitetura, lembre-se dos pares contrastantes: CISC = instruções complexas, microprogramação, formato variável, menos registradores; RISC = instruções simples, pipeline facilitado, formato fixo, muitos registradores, compilador mais robusto.