Questão de Arquitetura de Computadores — Memória — UFCG 2025
Arquitetura de Computadores›Memória
Código
qg619315
Banca
UFCG
Órgão
UFCG
Ano
2025
Nível
Médio
Cargo
Técnico de Tecnologia da Informação
Sobre o Acesso Direto à Memória (DMA), assinale a alternativa CORRETA:
AO controlador de DMA tem acesso ao barramento do sistema e contém vários registradores que podem ser lidos ou escritos na CPU, incluindo registrador de endereço de memória, registrador de controle e registrador de contador de bytes.
BO controlador lê um bloco do dispositivo, byte a byte, até que todo bloco esteja no buffer do controlador.
CMuitos barramentos de DMA podem operar em dois modos: modo uma palavra de cada vez e modo em buffer.
DNo modo bloco, o controlador do DMA diz ao dispositivo para obter o barramento, emite uma série de transferências e então libera o barramento. Esse modo de operação é chamado de modo ciclo.
EEm geral, apenas 3 (três) controladoras de DMA estão disponíveis numa placa-mãe.
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GabaritoA — O controlador de DMA tem acesso ao barramento do sistema e contém vários registradores que podem ser lidos ou escritos na CPU, incluindo registrador de endereço de memória, registrador de controle e registrador de contador de bytes.
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Acesso Direto à Memória (DMA)
Gabarito: letra A. O controlador de DMA realmente dispõe de registradores como endereço de memória, controle e contador de bytes, além de acessar o barramento do sistema. As demais alternativas contêm erros conceituais sobre os modos de operação e a quantidade de controladores.
Controlador de DMA: Registradores (Endereço de memória, Controle, Contador de bytes); Acesso ao barramento do sistema; Modos de operação (Burst (bloco contínuo), Cycle stealing (uma palavra por ciclo), Transparente (CPU não usa barramento)); Transferência (Em blocos (não byte a byte), Sem intervenção da CPU)
Alternativa A — ✅ Correta ⟵ GABARITO
Descreve precisamente a estrutura do controlador de DMA: ele se conecta ao barramento do sistema e possui registradores que a CPU pode ler/escrever — especificamente o registrador de endereço de memória, o registrador de controle e o registrador de contador de bytes (estes são os típicos registradores de um controlador DMA). A CPU inicializa esses registradores e o controlador realiza a transferência sem intervenção adicional.
Alternativa B — ❌ Incorreta
Afirma que o controlador lê o dispositivo byte a byte até preencher o buffer. Esse comportamento é típico de E/S programada (PIO), não de DMA. No DMA, a transferência é feita em blocos diretamente entre o dispositivo e a memória, sem que a CPU leia cada byte individualmente. O controlador de DMA opera em modos como burst, cycle stealing ou transparente, mas nunca lendo byte a byte.
Alternativa C — ❌ Incorreta
Menciona dois modos: "uma palavra de cada vez" e "modo em buffer". A terminologia padrão para modos de DMA inclui burst mode (bloco contínuo), cycle stealing (uma transferência por ciclo) e transparent mode (quando a CPU não usa o barramento). A expressão "modo em buffer" não é um modo de operação reconhecido; barramentos de DMA podem operar em modos como demand mode ou single transfer mode, mas não exatamente como descrito.
Alternativa D — ❌ Incorreta
Descreve o modo bloco (burst): o controlador toma o barramento, realiza várias transferências seguidas e o libera. Contudo, nomeia esse modo como "modo ciclo". Na verdade, o termo correto para essa operação é burst mode ou modo bloco. "Modo ciclo" geralmente se refere a cycle stealing, onde uma palavra é transferida por ciclo, intercalando com a CPU. A alternativa confunde os dois modos.
NÃO CAIA NESSA!
A banca mistura os conceitos de burst mode e cycle stealing. No modo bloco (burst), o DMA ocupa o barramento continuamente; no ciclo, ele "rouba" um ciclo de barramento da CPU. A alternativa D inverte a definição: descreve o burst mas chama de ciclo.
Alternativa E — ❌ Incorreta
Afirma que existem apenas 3 controladoras de DMA numa placa-mãe. Na arquitetura tradicional (ISA), havia 8 canais DMA (0 a 7), sendo que alguns são reservados (ex.: canal 2 para disquete, canal 4 para cascata). Em sistemas modernos, o número pode variar, mas não é limitado a 3. A literatura técnica menciona "8 portas de DMA". Portanto, a assertiva é falsa.