Questão de Engenharia Eletrônica — Eletrônica Digital na Engenharia Eletrônica — CEPERJ 2012

Deseja-se construir um circuito sequencial síncrono, a partir de fiip-fiops JK master-slave, que gerem a sequência de estados lógicos indicados abaixo. Um pulso de “reset" é gerado automaticamente, quando o circuito é alimentado, a fim de assegurar o estado inicial especificado. As mudanças de estado devem ocorrer devido a pulsos aplicados às entradas de “clock" (ck) dos fiip-fiops. Com base nisso, a equação de controle do fiip-fiop mais significativo é.

1. AJ₂= Q₁Q₀ e K₂=1
2. BJ₂=Q₂e K₂=1
3. CJ₂=Q₀e K₂=1
4. DJ₂= Q₂Q₁ e K₂=1
5. EJ₂=Q₂Q₀ e K₂=1